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S516
S516
RISC-V 64位架構(gòu)IP
S516:
奕斯偉計(jì)算S516 64位AI加速處理器是一款滿足RVA23-Profile的高能效RISC-V應(yīng)用級(jí)CPU IP產(chǎn)品。
適用于邊緣計(jì)算、智能電視、機(jī)頂盒、電腦、移動(dòng)終端等智能計(jì)算領(lǐng)域。
適用于邊緣計(jì)算、智能電視、機(jī)頂盒、電腦、移動(dòng)終端等智能計(jì)算領(lǐng)域。
特性
| 特性 | 描述 | ||||
| 指令集架構(gòu) | RVA23+Vector Crypto | ||||
| 多核 | 單Cluster最多支持8核 | ||||
| 模式 | 機(jī)器模式（Machine-mode）、超級(jí)監(jiān)督模式（Hypervisor-mode）、監(jiān)督模式（Supervisor-mode）、用戶模式（User-mode） | ||||
| 安全 | 支持ESWIN可信執(zhí)行環(huán)境（TEE）方案，物理內(nèi)存保護(hù)（PMP） 區(qū)域最高可達(dá)64個(gè) | ||||
| 加解密模塊（Crypto） | 支持可選標(biāo)量、向量硬件加解密模塊 | ||||
| 矢量擴(kuò)展（Vector） | 支持RVV1.0，寬度可配置（128位，256位，512位或1024位） | ||||
| 虛擬化 | Virtualization - IOMMU +AIA | ||||
| 流水線 | 8級(jí)超標(biāo)量順序流水線，2路解碼 | ||||
| 分支預(yù)測(cè)器（BP） | L0_BTB, IJTB, NN-Predictor, RAS, Loop Buffer | ||||
| 預(yù)取 | 支持指令預(yù)取，數(shù)據(jù)預(yù)取 | ||||
| 架構(gòu)特色 | 支持指令融合，write streaming mode，部分亂序 | ||||
| L1指令緩存（L1 I$） | 大小可選配（8KB，16KB，32KB 或 64KB）, ECC 可選 | ||||
| L1數(shù)據(jù)緩存（L1 D$） | 大小可選配（8KB，16KB，32KB 或 64KB）, ECC 可選 | ||||
| 共享最后一級(jí)緩存（Cluster LLC） | 大小可選配（256KB-4MB）, ECC 可選 | ||||
| 內(nèi)存管理單元 | SV39/SV48，ITLB，DTLB 支持PTE（Page Table Entry）硬件自修改 |
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| 中斷 | APLIC（AIA+PLIC） | ||||
| 調(diào)試跟蹤 | 調(diào)試模塊（Debug module）支持JTAG 跟蹤模塊（Trace module）支持 RISC-V標(biāo)準(zhǔn)的 E-Trace/N-Trace |
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| 總接線口 | 1.內(nèi)存接口（Memory Port）：128 位 AXI 主接口 2.外設(shè)接口（Peripheral Port）：64位 AXI 主接口 3.前置接口（Front Port）：128 位 AXI 從接口 |
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京公網(wǎng)安備 11030102011303號(hào)