特性 | 描述 | ||||
指令集架構(gòu) | RISC-V 32位 IMAC(B)(F) | ||||
模式 | 支持機(jī)器模式(Machine-mode)和用戶模式(User-mode) | ||||
安全 | 支持Smepmp;可選0-16個(gè)物理內(nèi)存保護(hù)(PMP)區(qū)域 支持 PPMA(Programmable Physical Memory Attributes) 檢查 |
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流水線 | 2級(jí)流水線 | ||||
處理器內(nèi)存儲(chǔ) | TIM0 和 TIM1,大小均可配置(0KB-128MB),ECC 可選 | ||||
L1 指令緩存(L1 I$) | 大小可配置(4KB-128KB),Parity/ECC 可選 | ||||
L1 數(shù)據(jù)緩存(L1 D$) | 大小可配置(4KB-128KB),Parity/ECC 可選 | ||||
中斷 | CLIC 中斷控制器,支持高達(dá) 112個(gè)中斷請(qǐng)求,支持不可屏蔽中斷(NMI) | ||||
調(diào)試 | 調(diào)試模塊(Debug module)支持JTAG/cJTAG | ||||
總線接口 | 1.指令緩存接口(ICache Port):32位AHB主接口 2.數(shù)據(jù)緩存接口(DCache Port):32位AHB主接口 3.指令緩存接口和數(shù)據(jù)緩存接口可合為一個(gè)系統(tǒng)接口(System Port):32位AHB主接口 4.外設(shè)接口(Peripheral Port):32位 AHB主接口 5.前置接口(Front Port): 32位 AHB從接口,用于從外部訪問 TIM |
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CoreMark (CoreMarks/MHz) | 4.65 | ||||
Dhrystone-Legal (DMIPS/MHz) | 1.90 |